Titre du poste

Ingénieur Vérification VHDL - F/H

Description

ELSYS Design recherche un ingénieur en vérification FPGA afin de renforcer son pôle de compétences en place à Cesson-Sévigné (35). Dans ce contexte, vous participerez à la vérification et validation de differentes IP dans un environnement normé aéronautique sur FPGA. Nous vous proposons d'intégrer une équipe de 6 ingénieurs et de monter en compétences sur ces projets par l'accompagnement de notre leader technique et le chef de projet. 

Qualifications

Titulaire d’un diplôme d’ingénieur en électronique ou d’un diplôme universitaire équivalent avec minimum 5 ans d'expérience dans le domaine de la microélectronique numérique.

Votre passion, votre dynamisme et votre capacité à transmettre dans des contextes variables seront des atouts pour vous épanouir dans ce rôle.

Compétences recherchées :

Maîtrise du flot de développement FPGA
Maîtrise de langage de description RTL (VHDL, Verilog, SystemVerilog)
Analyse, réutilisation et modification de blocs complexes
Pratique de la gestion de configuration (Git, SVN, ClearCase)
Bonne compréhension en anglais technique (écrit et oral)

Qualités requises :

Avoir une capacité d’apprentissage et une rigueur dans l’exécution
Savoir travailler en équipe et avoir le sens du service
Avoir une certaine facilité à communiquer avec différents types d'interlocuteurs

Type de poste
Temps plein
Secteur
INGÉNIERIE, ÉTUDES TECHNIQUES
Lieu du poste
CESSON SEVIGNE, 35051, France
Salaire de base
40000€-60000€ Par an
Date de publication
9 septembre 2024 à 21:02
Valide jusqu’au
9 octobre 2024 à 00:00
Exportation PDF

Offre terminée le 9 octobre 2024 à 00:00

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